Parte IV Architettura della CPU Central Processing Unit
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- Giuliano Carmelo Cappelli
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1 Parte IV Architettura della CPU Central Processing Unit IV.1
2 Struttura della CPU All interno di un processore si identificano in genere due parti principali: l unità di controllo e il data path (percorso dei dati). Oltre a queste possono esserne presenti altre, per esempio: una FPU(Floating Point Unit) che si occupa di eseguire calcoli in virgola mobile; una MMU (Memory Management Unit) che si occupa di tradurre gli indirizzi di memoria logici in indirizzi fisici, supportando la protezione della memoria e/o uno o più meccanismi di memoria virtuale. Il data path comprende i dispositivi in grado di elaborare i dati (una o più unità aritmetico logiche, ALU, Arithmetic Logic Unit), e alcune unità di memorizzazione temporanea poco capienti e ad accesso molto veloce, i registri, in cui i dati da elaborare e i risultati dell elaborazione vengono conservati per renderne più agevole la gestione; la lunghezza del registro indica il numero di bit che esso può contenere. IV.2
3 Struttura della CPU IV.3
4 La Sezione di Controllo FETCH Fase di prelievo nel corso della quale l istruzione individuata dal registro PC Program Counter viene trasferita nel registro IR Instruction Register e il contenuto di PC viene aggiornato in modo da puntare all istruzione successiva DECODE/EXECUTE Fase di decodifica e di esecuzione dell istruzione contenuta nel registro IR IV.4
5 Pentium II Architettura a 32 bit completamente compatibile con i predecessori, 266 e 333 MHz Aritmetica Floating-point IEEE 754 Bus di memoria a 64 bit Cache 1 o livello 16KB dati +16KB istruzioni Cache 2 o livello 256/512 KB nel package SEC (Single Edge Cartridge) a 242 pin Dissipa oltre 55W! IV.5
6 Microarchitettura del Pentium II A L U IV.6
7 Memorie cache Scopo della cache: disaccoppiare le velocità di CPU e RAM Località spaziale: alta probabilità di accedere in tempi successivi a indirizzi molto vicini Località temporale: alta probabilità di accedere più volte agli stessi indirizzi in tempi molto vicini Gerarchie di cache: a 2 o 3 livelli Cache inclusive: ciascuna contiene sempre quella del livello superiore IV.7
8 Pipeline e architetture superscalari Per aumentare la capacità di elaborazione della CPU: Pipeline a molti stadi (anche 10 e più) Architetture superscalari: parti di pipeline (o intere pipeline) multiple Latenza: tempo necessario a completare l elaborazione di un istruzione Banda della CPU: numero di istruzioni elaborate nell unità di tempo Pipeline e architetture superscalari aumentano la banda della CPU ma non riducono la latenza IV.8
9 Pinout Logico del µp Significato dei vari Pin Indirizzamento Dati Controllo Controllo del ciclo di bus Gestione delle interruzioni Arbitraggio del bus Gestione del coprocessore Segnalazione di stato Vari (alimentazione etc.) IV.9
10 Pinout Logico del µp Significato dei vari Pin due dei parametri chiave che determinano le performance della CPU sono il numero degli address pin e dei data pin un chip con m address pin può indirizzare 2 m locazioni di memoria Un chip con n data pin può leggere e scrivere una n-bit word in una singola operazione ( se n=8 faccio 4 operazioni per leggere una word di 32 bit ) Oggi sia m che n valgono 32 o 64 IV.10
11 I problemi del Pentium II IA-32 è irrimediabilmente meno potente di quanto si necessita al progredire delle tecnologie 4 GB di spazio di indirizzamento: ormai poco per un grosso server IV.11
12 Pentium III Intel potenzia la tecnologia del Pentium II. Il Pentium III, fino a 1.26 GHZ, utilizza: memorie Synchronized Dynamic Random Access Memory (SDRAM), che permettono un veloce trasferimento dei dati tra il microprocessore e la memoria. 70 nuove istruzioni, chiamate Streaming SIMD Extensions, che potenziano le caratteristiche multimediali e 3D. una cache con una più ampia banda 100 MHz front-side bus IV.12
13 Pentium 4 32-bit microprocessore, fino a 3.4MHZ, con tecnologia hyperpipelined, una larghezza di banda tre volte quella del Pentium III, L2 fino a 2 MB, FSB fino a 800 MHz, disegnato per i giochi on line, video e foto digitali, riconoscimento vocale e gestione MP3. Inoltre: Nuova Level 1 cache technology, che migliora ancora la comunicazione tra microprocessore e memoria NetBurst microarchitecture, che raddoppia la lunghezza della pipeline fino a 20 stati. Estensione della Streaming SIMD extension 2 (SSE2) nuove istruzioni, con un 128-bit SIMD integer arithmetic e 128-bit SIMD double precision floating point instructions. IV.13
14 L architettura IA-64 Dopo aver spremuto fino in fondo la IA-32, Intel rompe con il passato e propone una nuova ISA: la IA-64 La IA-64 è una architettura a 64 bit, dual core ( e sono allo studio 80 cuori ), nuovi supermateriali. Nome iniziale Pentium 4 serie 600/Itanium ( 2001/2002) EPIC Explicitly Parallel Instrucion Computing è il termine usato da Intel quando fa riferimento a questa nuova tecnologia Ampio uso di pipeline Raddoppio della memoria cache a 2 MB Tecnologia SpeedStep utilizzata nei notebook per ridurre la dissipazione dei chip Tanto per non parlare di compatibilità all indietro è un processore dual-mode e può eseguire anche il vecchio codice IA-32 IV.14
15 Evoluzione architettura IA-64 Nuovi materiali, puntando a realizzare nuovi microprocessori con circuiti di 45 /32 nanometri ( oggi siamo a 45 ), che vuol dire minore dispersione di corrente (e quindi meno calore e consumo energetico) e aumento della velocità, anche più del 20%. Miglioramenti di architetture interne Enhanced Intel SpeedStep Technology e Intel Virtualization Technology Intel Core 2 Duo Processors 64 bit, dual core, 65nm. IV.15
16 Architettura dei computer paralleli Le frequenze dei clock sono in crescita ma. La velocita della luce e un limite. Sempre di piu emerge il problema della dissipazione di calore.. Per cui l architettura dei computer farà ricorso sempre maggiormente al calcolo in parallelo, come il Dual Core di Intel IV.16
17 Architettura dei computer paralleli Progettati per eseguire in parallelo più job ( tipo banche) Oppure lo stesso job costituito da molti processi paralleli ( come un programma di scacchi) IV.17
18 Architettura dei computer paralleli Multiprocessore tutte le CPU condividono la memoria fisica CPU CPU Memoria condivisa CPU CPU IV.18
19 Multiprocessors (a) multiprocessor con 16 CPU che condividono la stessa memoria (b) Una immagine viene partizionata in 16 sezioni, ognuna analizzata dalle 16 differenti CPU IV.19
20 Architettura dei computer paralleli Multicomputer tutte le CPU hanno la loro memoria CPU + Mem CPU + Mem Rete di interconnessione CPU + Mem CPU + Mem IV.20
21 Multicomputers (a) multicomputer con 16 CPU, ognuno con la propria memoria (b) L immagine della slide precedente viene splittata fra le diverse 16 memorie IV.21
22 Architettura dei computer paralleli I multiprocessori sono difficili da costruire Ma facili da programmare I multicomputer sono facili da costruire Ma difficili da programmare Vari sforzi per costruire sistema ibrido Concentrandosi sulle reti di interconnessione IV.22
23 Esercizio Una Architettura di computer paralleli di tipo multiprocessor è realizzata con sedici CPU e deve analizzare una immagine complessa. Una sola delle seguenti affermazioni è vera: Tutte le CPU lavorano contemporaneamente sull intera immagine L immagine viene divisa in sedici porzioni ciascuna esaminata da una differente CPU A turno ogni CPU esamina l intera immagine Motivare brevemente la risposta (massimo tre righe + 1 figura) IV.23
Parte IV. Architettura della CPU Central Processing Unit
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