Esercizi(Assembler(8086(e(ARM( per(il(corso(di(architetture(dei(sistemi(di(elaborazione( Prof.(Mezzalama,(Ing.(Bernardi( v1.0marzo2013 Autore:MaggioLuigi E6mail:luis_may86@libero.it Portfolio:http://www.luigimaggio.altervista.org
Indice'della'versione'completa' INTRODUZIONE*AI*PERIFERICI*8086* 2 INTERFACCIAPARALLELA8255 2 INTERFACCIASERIALE8250 8 TEMPORIZZATOREDIINTERVALLI8253 12 ESERCIZI*ASSEMBLER*8086* 16* ESERCIZIO1* 16 ESERCIZIO2 17 ESERCIZIO3 19 ESERCIZIO4 21 ESERCIZIO5* 24 ESERCIZIO6 25 ESERCIZIO7* 27 ESERCIZIO8 28 ESERCIZIO9* 30 ESERCIZIO10 32 SISTEMADIRIFERIMENTO35 ESERCIZIO11* 36 ESERCIZIO12 40 ESERCIZIO13* 45 ESERCIZIO14 51 ESERCIZIO15* 59 ESERCIZIO16 66 ESERCIZIO17* 72 ESERCIZIO18 76 ESERCIZIO19 82 ESERCIZIO20* 90 ESERCIZIO21 95 ESERCIZIO22* 99 ESERCIZIO23 103 ESERCIZIO24* 108 ESERCIZIO25117 ESERCIZI*ASSEMBLER*ARM* 121* SISTEMADIRIFERIMENTO 121 ESERCIZIO1 122 ESERCIZIO2 124 ESERCIZIO3 126 ESERCIZIO4 128 ESERCIZIO5 130
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EserciziAssemblerperilcorsodiArchitetturedeiSistemidiElaborazione 9 EO (Empty Output) = 1: il dato contenuto nel registro THR è stato trasmesso. Posto a 0 quando il processore scrive in THR. I flag di errore nel registro LSR sono:
EserciziAssemblerperilcorsodiArchitetturedeiSistemidiElaborazione 10 Parity error: errore di trasmissione rilevato attraverso il bit di parit.; Framing error: mancata ricezione di un bit di stop; Overrun error: il ricevitore ha ricevuto un nuovo dato senza che la CPU abbia letto il dato contenuto nel buffer ricevente. I flag di errore sono posti a 0 dopo che il processore legge il registro LSR. La segnalazione di tali errori non blocca il funzionamento dell UART, ma è compito della CPU operare le necessarie azione correttive.
EserciziAssemblerperilcorsodiArchitetturedeiSistemidiElaborazione 11 ERBK (Error & Break) = 1: abilitazione ad effettuare una richiesta di interruzione quando viene rilevato un errore o un segnale di break SINP (Serial Input) = 1: abilitazione ad effettuare una richiesta di interruzione quando uno dei segnali di input del protocollo RS-232 (CTS, DSR, DCD, RI) cambia di stato
EserciziAssemblerperilcorsodiArchitetturedeiSistemidiElaborazione 12 CLOCK GATE OUT (3 x 3 pin): ingresso, output e clock per ogni contatore CS RD WR: selezionano che operazioni effettuare sul dispositivo GND VCC: alimentazione e ground del circuito
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EserciziAssemblerperilcorsodiArchitetturedeiSistemidiElaborazione 14 BCD: definisce il metodo di conteggio. 0 = binario, 1 = BCD modo 0: Interrupt al Termine del Conteggio modo 1: One-shot programmabile modo 2: Generatore di Frequenza modo 3: Generatore di Onde Quadre modo 4: S/W Triggered Strobe modo 5: H/W Triggered Strobe Tali modalità di funzionamento possono essere divisi in 2 categorie: quelli che generano una forma d onda dopo N colpi di clock
EserciziAssemblerperilcorsodiArchitetturedeiSistemidiElaborazione 15 quelli che generano forme d onda periodiche dopo N (divisore di frequenza).
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EserciziAssemblerperilcorsodiArchitetturedeiSistemidiElaborazione 48 Siscrivanolesequenzediistruzionidaincludere: 1. all avvio del sistema per abilitate le interruzioni generate dalla porta UART esclusivamenteaseguitodiunerroreditrasmissione. 2. nellaroutinediserviziodegliinterruptuartperidentificarelospecificoerrore.
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